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1. 并行高效BCH译码器设计及FPGA实现

张湘贤杨涛魏东梅向玲

计算机应用 2012, 32 (03): 867-869. DOI: 10.3724/SP.J.1087.2012.00867

摘要（1046）

PDF （510KB）（600）

针对并行BCH译码器的特点,采用异或门实现有限域上常系数乘法,从而降低硬件复杂度。先计算部分错误位置多项式,再根据仿射多项式和格雷码理论,进行逻辑运算得到剩余的错误位置多项式,从而减少了系统所占用的资源。在现场可编程门阵列(FPGA)开发软件ISE10.1上进行了时序仿真,验证了该算法时间和空间的高效性。

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2. 基于FPGA的Fm2域椭圆曲线点乘的快速实现

魏东梅杨涛

计算机应用 2011, 31 (02): 540-542.

摘要（1371）

PDF （448KB）（1299）

椭圆曲线点乘的实现速度决定了椭圆曲线密码算法（ECC）的实现速度。采用蒙哥马利点乘算法，其中模乘运算、模平方运算采用全并行算法，模逆运算采用费马·小定理并在实现中进行了优化，完成了椭圆曲线点乘的快速运算。采用Xilinx公司的Virtex-5器件族的XCV220T作为目标器件，完成了综合与实现。通过时序后仿真，其时钟频率可以达到40MHz，实现一次点乘运算仅需要14.9μs。